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摘要：本文介绍了一种采用 130 nm SiGe BiCMOS 技术设计的小面积单片像素探测器 ASIC，用于升级 CERN 的 FASER 实验的预流探测器。该原型的目的是研究快速前端电子器件在像素敏感区域内的集成，并确定能够最好地满足实验规格的配置。为了应对与像素内前置放大器和鉴别器集成相关的若干挑战，自感噪声、不稳定性和串扰被最小化。还将描述用于特性描述和设计选择的方法。这里研究的两种变体将在 FASER 实验预流的预生产 ASIC 中实施，以进行进一步测试。
arXiv:2111.11184v1 [physics.ins-det] 2021 年 11 月 22 日
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